Logo ČVUT
ČESKÉ VYSOKÉ UČENÍ TECHNICKÉ V PRAZE
STUDIJNÍ PLÁNY
2018/2019

Computer Units

Přihlášení do KOSu pro zápis předmětu Zobrazit rozvrh
Kód Zakončení Kredity Rozsah Jazyk výuky
BIE-JPO Z,ZK 5 2+2
Přednášející:
Pavel Kubalík (gar.)
Cvičící:
Pavel Kubalík (gar.)
Předmět zajišťuje:
katedra číslicového návrhu
Anotace:

Students are acquainted with the internal structure and organization of computer units and their interfacing with the environment. They also learn the organization of various memory types (main memory, LIFO, FIFO and CAM), design methodology of control units and basic principles of bus communication. Students get skills needed for computer engineers.

Požadavky:

Basic knowledge of the structure and architecture of a digital computer, design principles for combinational and sequential circuits, binary arithmetic, principles of computer memory.

Osnova přednášek:

1. Organization and structure of von Neumann computers.

2. Binary adders, subtractors, and shifters.

3. Arithmetic and logic unit of a simple processor.

4. Control unit and controllers; microprogrammed control unit.

5. Wired control unit.

6. Binary multiplication and division and their implementation.

7. Floating point representation.

8. Basic principles of error detection and correction.

9. Linear and cyclic codes.

10. Main memory - possible organizations and interfaces.

11. Other internal memories, their organization and use - addressable memories, LIFO, FIFO, CAM.

12. I/O units and their control - DMA, channels and I/O processors.

13. Buses - types, modes, arbitration.

Osnova cvičení:

1. Number systems, conversions and operations.

2. Representations of negative numbers.

3. Simple processor - instructions, machine code, data part.

4. Simple processor - instruction cycle, interface.

5. Simple processor - microprogramming.

6. Simple processor - demonstration of a microprogram.

7. Wired controller design.

8. Multipliers and dividers.

9. Floating point representation.

10. [2] Design of a processor component on FPGA.

11. Demonstration of the designed processor component.

12. Error detection codes.

Cíle studia:

The module teaches future computer engineers the way how to design their own processors for a specific purpose, what units must be contained in a processor or a computer, and how these units communicate. Everything is demonstrated in hands-on experiments with FPGA and simulators.

Studijní materiály:

1. Hennesy, J. L., Patterson, D. A. ''Computer Architecture: A Quantitative Approach, Third Edition''. Morgan Kaufmann, 2002. ISBN 1558605967.

2. Tanenbaum, A. S. ''Structured Computer Organization (5th Edition)''. Prentice Hall, 2005. ISBN 0131485210.

3. Stallings, W. ''Computer Organization and Architecture: Designing for Performance (7th Edition)''. Prentice Hall, 2005. ISBN 0131856448.

4. Hamacher, C., Vranesic, Z., Zaky, S. ''Computer Organization''. McGraw-Hill, 2001. ISBN 0072320869.

Poznámka:

Informace o předmětu a výukové materiály naleznete na https://courses.fit.cvut.cz/BIE-JPO/

Rozsah=prednasky+proseminare+cviceni2p+2c

Další informace:
https://courses.fit.cvut.cz/BIE-JPO/
Rozvrh na zimní semestr 2018/2019:
06:00–08:0008:00–10:0010:00–12:0012:00–14:0014:00–16:0016:00–18:0018:00–20:0020:00–22:0022:00–24:00
Po
Út
místnost TH:A-942
Kubalík P.
09:15–10:45
(přednášková par. 1)
Thákurova 7 (FSv-budova A)
St
místnost TH:A-1042
Kubalík P.
12:45–14:15
(přednášková par. 1
paralelka 101)

Thákurova 7 (FSv-budova A)
Hlavickova laborka
Čt

Rozvrh na letní semestr 2018/2019:
Rozvrh není připraven
Předmět je součástí následujících studijních plánů:
Platnost dat k 18. 2. 2019
Aktualizace výše uvedených informací naleznete na adrese http://bilakniha.cvut.cz/cs/predmet1450006.html